在Verilog HDL语言中,a=4'b1010 ,那么&a= ( )。
A: 4'b1010
B: 4'b000
C: 1'b0
D: 1'b1
A: 4'b1010
B: 4'b000
C: 1'b0
D: 1'b1
C
举一反三
- 已知 a =4’b1010,b=4’b1100,那么&(a & b)=( ) A: 4’b1010 B: 1’b1 C: 4’b1000 D: 1’b0
- 在verilog语言中,a=4’b1011,那么&a=( ) A: 4’b1001 B: 4’b1111 C: 1’b1 D: 1’b0
- 在Verilog HDL的逻辑运算中,设a=4´b1010,a>>1结果是()。
- 在Verilog HDL中a=4b’1001那么&a=( ) A: 4’b 1001 B: 4’b 1111 C: 1’b1 D: 1’b0
- 在Verilog HDL的逻辑运算中,设 a = 4´b1010, a >>1结果是( )。 A: 4´b0101 B: 4´b1011 C: 4´b1110 D: 4´b0001
内容
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在Verilog HDL的逻辑运算中,设 a = 4´b1010, a >>1结果是( )。 A: 4´b0101 B: 4´b1011 C: 4´b1110 D: 4´b0001
- 1
【单选题】已知 a =4’b1010,b=4’b1100,那么a & b=() A. 4’b1010 B. 4’b0110 C. 4’b1000 D. 1
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在verilog 语言中,a=4'b1011;则 &a=( ). A: 4"b1011; B: 4"b1111; C: 1'b0 D: 1'b1
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在Verilog中,已知a=4’b1011;那么|a的值为( ) A: 4’b1011 B: 4’b1111 C: 1’b1 D: 1’b0
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在Verilog HDL的逻辑运算中,设A=4´b1010,则表达式~A的结果为